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ISL97677
Pin Configuration
ISL97677
(32 LD 5X5 QFN)
TOP VIEW
32
31
30
29
28
27
26
25
PGND
SMBCLK/SCL
SMBDAT/SDA
PWM
AGND
AGND
AGND
AGND
1
2
3
4
5
6
7
8
EXPOSED THERMAL PAD
24 NC
23 OVP
22 PGND
21 LX
20 LX
19 PGND
18 VDC
17 EN
9
10
11
12
13
14
15
16
Pin Descriptions
(I = Input, O = Output, S = Supply)
PIN
1, 19, 22
2
3
4
5, 6, 7, 8, 9,
NAME
PGND
SMBCLK/SCL
SMBDAT/SDA
PWM
AGND
TYPE
S
I
I/O
I
S
Power Ground
SMBus/I 2 C Serial Clock Input
SMBus/I 2 C Serial Data Input and Output
PWM Brightness Control
Analog Ground
DESCRIPTION
15
10
11
12
13
14
16
17
18
20, 21
23
24
25 ~ 32
VLOGIC
FSW
FPWM
RSET
COMP
VIN
EN
VDC
LX
OVP
NC
CH1 ~ CH8
4
O
I
I
I
O
S
I
S
O
I
I/O
I
Internal 2.5V Logic Bias Regulator. Need Decoupling Capacitor for Regulation
When R fSW is 100k Ω , f SW is 500kHz.
When R fSW is 33k Ω , f SW is 1.5MHz
When R FPWM is 333k Ω , F PWM is 200Hz.
When R FPWM is 3.3k Ω , F PWM is 20kHz.
Resistor Connection for Setting LED Current
Boost compensation
Main Power
Enable
Internal 5V Analog Bias Regulator. Needs Decoupling Capacitor for Regulation
Boost MOSFET Drain Terminal Switching Node
Overvoltage Protection Input as well as Output Voltage FB Monitoring
No Connect
LED Driver PWM Dimming Monitoring
FN6996.1
November 13, 2009
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